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门级晶体管级混适时序剖析解决方案
自动识别设计中的特殊器件,并使用拓扑结构和沟道毗连提取手艺发生门级电路。
提取的门级单元的时序特征被自动特征化并用于静态时序剖析(STA)。
内置STA引擎。
支持对寄生举行反标的SPICE网表自动生乐成能。
高效的全芯片要害路径定位
自动提取带有寄生参数的要害路径
定制单元快速特征化
统一的静态时序剖析和动态仿真情形
自界说单元特征
混淆信号设计时序剖析
尺度单元库重新特征化
CPU数据通道/数字IP时序剖析
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